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邏輯函數(shù)基于AXIG實現(xiàn)面積優(yōu)化

趙思思; 夏銀水; 馬雪嬌; 吳世雄 寧波大學(xué)電路與系統(tǒng)研究所; 寧波315211

摘要：該文提出了一種邏輯函數(shù)基于與/異或/非圖（And-Xor-Inverter graph,AXIG）的雙邏輯優(yōu)化與映射方法：通過AXIG結(jié)構(gòu)表示TBL和RML,選擇不同的XOR結(jié)構(gòu)進行圖壓縮,并對映射過程中的局部邏輯結(jié)構(gòu)重映射,最終實現(xiàn)邏輯函數(shù)的面積優(yōu)化方法。實驗結(jié)果表明,與學(xué)術(shù)界邏輯綜合優(yōu)化工具ABC相比,平均AXIG節(jié)點數(shù)明顯減少,電路中的晶體管數(shù)具有一定改進。

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